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求助——FPGA IBIS模型遇到的问题
1. 在ispLEVER新建工程后,导入你的代码,仿真IBIS,只需顶层就行,但要保证综合时不被优化掉
这步中的“导入代码”指的是啥代码?同时顶层是啥意思?
谢谢!
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推荐答案 2010-07-15
verilog或者VHDL都行,这个代码是要你自己用一种硬件语言编写的。顶层模块是指例化了I/O端口,也就是FPGA管脚的top文件。来自:求助得到的回答
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verilog或者VHDL都行,这个代码是要你自己用一种硬件语言编写的
。顶层模块是指例化了I/O端口,也就是FPGA管脚的top文件。
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