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VHDL中变量赋值为NOT是什么意思?
如题所述
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推荐答案 2011-03-22
应该是NOT 后面还有一个逻辑属性的数(std_logic)表示对这个数取反~
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and
not
这个语句
在vhdl中是什么意思?
比如c<=a and not b;
答:
AND
NOT
和数电里面讲的一样是 与 非 在计算是要看优先级
not
的
优先级在逻辑运算是最高 C
赋值为
A 与 (B 的非)
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